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兩種基于FPGA的軟件濾波方法


  來源: 儀器儀表商情網(wǎng) 時間:2015-08-06 作者:Stanford
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       在圖中,個格子分別代表寄存器的個位,寄存器左側(cè)的數(shù)據(jù)為已經(jīng)處理過的數(shù)據(jù),寄存器內(nèi)的個數(shù)據(jù)為正在處理的數(shù)據(jù),寄存器右側(cè)的數(shù)據(jù)為即將處理的數(shù)據(jù)。每過一個采樣時間間隔t,數(shù)據(jù)依次向高位滑動一位,最低位賦值為輸入信號當(dāng)前的狀態(tài)值。
       如上述過程,寄存器內(nèi)的數(shù)據(jù)在不斷地更新,數(shù)據(jù)每滑動一次,即對個采樣值進行一次判斷,從而達到濾波的目的。由于干擾脈沖的隨機性,采到高電平和低電平的概率是相等的,所以,作為判斷依據(jù)的百分比不能小于50%。在實際應(yīng)用中,為了使濾波更可靠,的取值一般都大于50%。
       2. 1 判決濾波程序設(shè)計
       本設(shè)計采用一個位寄存器( n = 9) ,每次判斷時只要‘1’的個數(shù)大于或等于5,則濾波輸出‘1’,否則輸出‘0’( X = 5 /9) 。圖為判決濾波程序的流程圖。
判決濾波程序流程圖
主要的程序進程如下:

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